标签为"电子电路"的文章
我没有去过你的城市,但我刷过你那的题毒鸡汤
AD使用小技巧:自动删除闭合走线回路
2023-12-18     loonlog     3566    0
在使用AD(Altium Designer)设计pcb的时候,我们经常需要对走线进行优化,当我们重新走一条网络的时候,希望软件自动清除旧的走线,或者我们给一条走线放置过孔的时候,希望自动清除旧的过孔,这样会提高效率 ...
AD软件PCB中怎么对芯片引脚间距单独设置安全规则
AD
电路
PCB
Altium designer
电子电路
硬件
软件
2023-10-20     loonlog     3181    0
我们在设计PCB的时候,经常会遇到芯片引脚间距小于我们设置的安全间距,进而DRC报错,如下图,(本文就依间距规则进行举例说明,其他属性,也是一样的步骤),虽然根据DRC列表逐一确认安全的情况下,可以不用单独设置,也无大碍 ...
Altium Designer (AD) Query语句的编写及检测
2023-09-15     loonlog     6407    0
平时在使用AD(Altium Designer)设计PCB的时候,经常会涉及一些诸如线宽,线距,过孔大小等的设置,我都是使用一种基础规则设置,有时候间距设置大于芯片引脚的间距,就会导致无法走线 ...
DDR硬件电源相关知识-VDD、VDDQ、VDDL、VPP、VTT
2022-11-30     loonlog     6692    0
对于电源电压,DDR SDRAM系统要求三个电源,分别为VDDQ、VTT和VREF。
1、主电源VDD、VDDQ和VPP
主电源的要求是VDDQ=VDD ...
AD原理图复制报InvalidParameter Exception Occurred In Copy错误的解决方法
2022-11-10     loonlog     2713    0
新安装的Altium Designer,复制原理图的时候,提示错误InvalidParameter Exception Occurred In Copy,原以为是盗版的原因,后来找到方法 ...
再次学习I2C总线时序以及ACK和NACK(NAK,NCK)
2022-03-10     loonlog     7166    1
平时工作中需要应对工作进度,节点,板子能运行,测试信号没问题就万事大吉了,很少去深究通信协议,因为本来之前是了解的,只是时间久了也记不太清楚,变成了似懂非懂,当板子或者软件调试不通的时候,就要去获取信号波形 ...
Allegro再次导入网表时保留元件位置(place changed component)
2021-12-16     loonlog     8281    0
有时候,我们需要对已经完成的pcb文件进行更新,比如更换了器件封装,这就需要重新导入网络表,默认的,软件会在你导入网表的时候,被更新元件会消失,需要你重新放置元器件,这样就造成已经布好格局会被打乱,还需要重新放置 ...
AD使用小技巧:自动删除闭合走线回路
2023-12-18     loonlog     3566    0
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AD软件PCB中怎么对芯片引脚间距单独设置安全规则
AD 电路 PCB Altium designer 电子电路 硬件 软件
2023-10-20     loonlog     3181    0
我们在设计PCB的时候,经常会遇到芯片引脚间距小于我们设置的安全间距,进而DRC报错,如下图,(本文就依间距规则进行举例说明,其他属性,也是一样的步骤),虽然根据DRC列表逐一确认安全的情况下,可以不用单独设置,也无大碍 ...
Altium Designer (AD) Query语句的编写及检测
2023-09-15     loonlog     6407    0
平时在使用AD(Altium Designer)设计PCB的时候,经常会涉及一些诸如线宽,线距,过孔大小等的设置,我都是使用一种基础规则设置,有时候间距设置大于芯片引脚的间距,就会导致无法走线 ...
DDR硬件电源相关知识-VDD、VDDQ、VDDL、VPP、VTT
2022-11-30     loonlog     6692    0
对于电源电压,DDR SDRAM系统要求三个电源,分别为VDDQ、VTT和VREF。
1、主电源VDD、VDDQ和VPP
主电源的要求是VDDQ=VDD ...
AD原理图复制报InvalidParameter Exception Occurred In Copy错误的解决方法
2022-11-10     loonlog     2713    0
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再次学习I2C总线时序以及ACK和NACK(NAK,NCK)
2022-03-10     loonlog     7166    1
平时工作中需要应对工作进度,节点,板子能运行,测试信号没问题就万事大吉了,很少去深究通信协议,因为本来之前是了解的,只是时间久了也记不太清楚,变成了似懂非懂,当板子或者软件调试不通的时候,就要去获取信号波形 ...
Allegro再次导入网表时保留元件位置(place changed component)
2021-12-16     loonlog     8281    0
有时候,我们需要对已经完成的pcb文件进行更新,比如更换了器件封装,这就需要重新导入网络表,默认的,软件会在你导入网表的时候,被更新元件会消失,需要你重新放置元器件,这样就造成已经布好格局会被打乱,还需要重新放置 ...